2 Mbit / 4 Mbit / 8 Mbit Multi-Purpose Flash
SST39LF200A / SST39LF400A / SST39LF800A
A Microchip Technology Company
SST39VF200A / SST39VF400A / SST39VF800A
Data Sheet
ADDRESS A MS-0
T CE
CE#
T OEH
T O E
TOES
OE#
WE#
DQ 6
TWO READ CYCLES
WITH SAME OUTPUTS
Note:
A MS = Most significant address
A MS = A 16 for SST39LF/VF200A, A 17 for SST39LF/VF400A and A 18 for SST39LF/VF800A
1117 F07.3
Figure 9: Toggle Bit Timing Diagram
SIX-BYTE CODE FOR CHIP-ERASE
T SCE
ADDRESS A MS-0
5555
2AAA
5555
5555
2AAA
5555
CE#
OE#
T WP
WE#
DQ 15-0
XXAA
SW0
XX55
SW1
XX80
SW2
XXAA
SW3
XX55
SW4
XX10
SW5
Note: This device also supports CE# controlled Chip-Erase operation. The WE# and CE# signals are
interchageable as long as minimum timings are met. (See Table 16)
AMS = Most significant address
AMS = A16 for SST39LF/VF200A, A17 for SST39LF/VF400A and A18 for SST39LF/VF800A
X can be VIL or VIH, but no other value.
Figure 10: WE# Controlled Chip-Erase Timing Diagram
1117 F08.7
? 2011 Silicon Storage Technology, Inc.
20
DS25001A
03/11
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